1.本发明涉及通信技术领域，具体的说，是一种可变采样率的模数转换数据传输方法。
背景技术：
2.市场上的模数转换芯片或数模转换芯片，通常使用jesd204协议接口进行两个芯片间的数据传输，jesd204协议接口是一种高速串行数据互连接口，接收和发送端配置到相同的线速率，建立高速串行链路然后才开始传输数据，串行线速率与采样率密切相关。什么样的采样率，就需要什么速率的高速串行互连。一旦切换采样率，需要中断当前互连链接，重新修改模数转换芯片配置，修改高速串行接口发送端和接收端锁相环配置，让串行链路切换至目标线速率重新建链，然后才能进行模数转换数据的传输。此外还需要提供系统参考时钟sys_ref供接收侧和发送侧参考。或者使用同步并行传输接口，使用多个数据管脚进行并行互连。但是存在以下问题：1）jesd204的劣势：采样率的切换，必须断开链路，重新修改发送和接收端的锁相环配置，重新建立链接，导致采样系统的时钟方案繁琐复杂；通常一个芯片上有两个模数转换器，如果向多个模数转换器提供传输服务，每个模数转换器的采样率必须满足线速率的限制；这些操作过程繁琐，耗费操作时间长，且受限于各个锁相环压控振荡器vco的有效范围，线速率的范围是有限的，这也意味着对不同模数转换器采样率支持的范围也是受限。2）源同步并行传输接口的劣势：受限于电路板上走线和时钟频率的限制，传输速率一般比较低。并行走线在板卡设计上有极大瓶颈，只能应用在低采样率的场合。
技术实现要素：
3.本发明的目的在于提供一种可变采样率的模数转换数据传输方法，在采样率切换时，串行链路无需断开；串行链路速率与采样速率无关，采样率切换，只需修改涉及模数转换器部分的锁相环配置，高速串行链路配置无需修改，链接继续保持；串行链路的线速率与模数转换器采样率不再有关系，不同采样率的数据也可以在同一个线速率下进行传输。
4.本发明通过下述技术方案解决上述问题：一种可变采样率的模数转换数据传输方法，包括：每个模数转换器在采样时钟下产生数据并写入对应的第一异步先入先出队列fifo，第一异步fifo的读侧与成帧模块通信连接，所述成帧frame模块通过串行互连接口与解帧模块建立高速串行链接，解帧deframe模块与第二异步fifo通信，用于接收数据并识别数据类型，以及传输到对应的第二异步fifo，第二异步fifo的读侧以采样时钟还原出数据流，其中，当第一异步fifo没有数据时，成帧模块发送空闲序列以维持链路，当第一异步fifo有数据时，成帧模块进入发帧状态；当模数转换器的采样率切换时，该模数转换器停止写入对应的第一异步fifo，进入复位状态，接收侧也停止读取对应的第二异步fifo，进入复位状态，当该模数转换器修改
了采样率的配置重新进入正常采样状态，重新开始写入第一异步fifo，接收侧对应的第二异步fifo的读时钟是重新配置的采样时钟频率，重新开始业务，第一异步fifo和第二异步fifo解除复位状态。
5.本发明在采样率切换时，串行链路无需断开；串行链路速率与采样速率无关，采样率切换，只需修改涉及模数转换器部分的锁相环配置。高速串行链路配置无需修改，链接继续保持。串行链路的线速率与模数转换器采样率不再有关系，不同采样率的数据也可以在同一个线速率下进行传输，能够增加业务形态，降低系统j9九游会真人的解决方案成本。
6.所述数据的帧结构包括帧头和帧类型标志字段，所述帧头用于区分业务类型，帧类型标志字段用于区分数据来自哪个模数转换器。
7.所述模数转换器的传输速率相同或者不同。所述串行互连接口的总传输速率大于所有模数转换器的传输速率和开销之和。
8.本发明与现有技术相比，具有以下优点及有益效果：（1）本发明在采样率切换时，串行链路无需断开，串行链路速率与采样速率无关，采样率切换，只需修改涉及模数转换器部分的锁相环配置，高速串行链路配置无需修改，链接继续保持。
9.（2）本发明串行链路的线速率与模数转换器采样率不再有关系，不同采样率的数据也可以在同一个线速率下进行传输，能够增加业务形态，降低系统j9九游会真人的解决方案成本。
10.（3）本发明具有高速串行互连接口，用来进行芯片间数据传输。串行互连的数据传输能力必须大于模数转换器采样的数据率，串行链接的线速率配置与模数转换器采样率无关，高速串行链接可以根据实际需求，使用一个或多个lane模式。
附图说明
11.图1为本发明的原理框图；图2为多个模数转换数据传输业务在链路层的数据传输结构示意图。
具体实施方式
12.下面结合实施例对本发明作进一步地详细说明，但本发明的实施方式不限于此。
13.实施例1：
14.结合附图1所示，一种可变采样率的模数转换数据传输方法，包括：每个模数转换器在一个采样时钟下产生一个数据（通常为2字节，复数通常为4字节）并写入对应的第一异步先入先出队列fifo进行跨时钟域操作，第一异步fifo的读侧是串行互连时钟域，与成帧frame模块通信连接，所述frame模块通过串行互连接口与解帧deframe模块通信连接，frame模块的功能机制是：当没有发送需求的时候，向对端发送空闲序列，以维持链路；当第一异步fifo里有数据产生发帧需求的时候，frame模块进入发帧状态，连续的发完一帧采样数据。frame发完一帧后又跳转回空闲状态继续发送idle序列，如图2所示，因此在同一个串行互连接口基础上，可以承载多种速率的模数转换数据的传输业务。因此，这在一个芯片上同时实现多种业务，提高对硬件成本的控制；deframe模块与第二异步fifo通信，第二异步fifo的数量与第一异步fifo匹配，第二异步fifo的读侧以采样时钟还原出数据流。由于承载多个业务的传输，需要在帧结构里区分不同业务。因此在帧的定
义里会有帧头，帧类型标志字段。发送侧对各个业务的数据都设置一个异步fifo，frame模块分时仲裁传输各个fifo里的数据，保证每个发送fifo的数据都不会溢出。
15.接收侧解析收到的数据帧，识别帧类型将有效数据写入到对应的第二异步fifo里。每个第二异步fifo的读侧，使用与对应的模数转换器采样时钟同源的时钟，第二异步fifo非空即读。由于同一个模数转换器ad（analog to digital）的速率的接收侧和发送侧同源时钟，两侧数据流量完全一致，经过高速串行链接，接收侧的第二异步fifo在非空即读的条件下，能够保持一直非空。因此能够在接收侧以采样时钟还原出ad数据流。
16.当一个ad业务的采样率切换时，首选发送侧对应的ad停止写入发送第一异步fifo，进入复位状态，接收侧也停止读取接收第二异步fifo，进入复位状态，底层串行链路继续保持，仍旧可传输其他ad数据业务。待切换的ad修改了采样率的配置重新进入正常采样状态，对应的ad重新开始写入第一异步fifo，接收侧的对应第二异步fifo的读时钟是重新配置的采样时钟频率。重新开始业务，两侧fifo解除复位状态，传输业务正常进行。
17.本发明在采样率切换时，串行链路无需断开；串行链路速率与采样速率无关，采样率切换，只需修改涉及ad部分的锁相环配置。高速串行链路配置无需修改，链接继续保持。串行链路的线速率与ad采样率不再有关系，不同采样率的数据也可以在同一个线速率下进行传输，能够增加业务形态，降低系统j9九游会真人的解决方案成本。
18.多个模数转换器的传输速率可以相同，也可以不同。
19.所述串行互连接口的总传输速率大于所有模数转换器的传输速率和开销之和。即具有n个高速串行收发器lane(n》=1)，每个lane的线速率为f（单位bit/s）。每个ad的采样速率为sn(mhz/s)，n=1，2，3，
……
，每个采样点具有16bit，在进入串行互连传输前要经过8b/10b编码器，编码之后16bit会扩展至20bit，那么n*f》s1*20 s2*20 s3*20
…
。
20.本发明具有高速串行互连接口，用来进行芯片间数据传输。串行互连的数据传输能力必须大于ad采样的数据率。串行链接的线速率配置与ad采样率无关。高速串行链接可以根据实际需求，使用一个或多个lane模式。
21.本发明的高速串行互连，是市场上常见的技术。本发明基于此技术，构建的ad采样传输系统的方法。本发明中高速串行互连速率配置与ad的采样时钟速率无关，ad速率的改变无需高速串行互连速率改变。
22.尽管这里参照本发明的解释性实施例对本发明进行了描述，上述实施例仅为本发明较佳的实施方式，本发明的实施方式并不受上述实施例的限制，应该理解，本领域技术人员可以设计出很多其他的修改和实施方式，这些修改和实施方式将落在本技术公开的原则范围和精神之内。